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電路學
超大型積體電路設計導論
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超大型積體電路設計導論
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超大型積體電路測試設計
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超大型積體電路測試設計
學歷
博士, 國立清華大學,台灣
2003.0-2011.0
2003.0-2011.0
與 UN SDG 相關的專業知識
聯合國會員國於 2015 年同意 17 項全球永續發展目標 (SDG)，以終結貧困、保護地球並確保全體的興盛繁榮。此人的作品有助於以下永續發展目標：
Keywords
- 計算機算術電路
- 數位影像處理電路
- 高效率擬亂數產器
- 數學模型之硬體電路實現
- 鎖相迴路設計
指紋
查看啟用 Chung-Yi Li 的研究主題。這些主題標籤來自此人的作品。共同形成了獨特的指紋。
- 1 相近領域學者
過去五年中的合作和熱門研究領域
國家/地區層面的近期外部共同作業。按一下圓點深入探索詳細資料，或
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為了近似計算中固定長度布斯乘法器之低誤差並硬體高效能的進化補償電路設計
Li, C.-Y. (PI)
01/08/24 → 31/07/25
研究計畫: 國家科學及技術委員會(原科技部) › 國家科學及技術委員會學術補助
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基於稀疏注意力神經網路以提高多閾值數位正子斷層掃瞄儀影像解析度的方法
Li, C.-Y. (PI), Chen, S. F. (CoPI), Lin, S. Y. (CoPI) & Liu, C. H. (CoPI)
01/08/23 → 31/07/24
研究計畫: 國家科學及技術委員會(原科技部) › 國家科學及技術委員會學術補助
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使用蹺蹺板應力緩解控制之串接式強健升壓型轉換電路設計
Li, C.-Y. (PI), Chen, H. C. (CoPI) & Lin, S. Y. (CoPI)
01/08/22 → 31/07/23
研究計畫: 國家科學及技術委員會(原科技部) › 國家科學及技術委員會學術補助
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利用限壓器達到在寬責任周期的交錯式倍升壓直流直流轉換器之內建的均流控制
Li, C.-Y. (PI) & Chen, H. C. (CoPI)
01/08/20 → 31/07/21
研究計畫: 國家科學及技術委員會(原科技部) › 國家科學及技術委員會學術補助
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Low-latency and power-efficient row-based binary-weighted compensator for fixed-width Booth multiplier
Li, C. Y., Hu, H. C., Chen, Y. H. & Lin, S. Y., 04 2025, 於: International Journal of Circuit Theory and Applications. 53, 4, p. 2409-2426 18 p.研究成果: 期刊稿件 › 文章 › 同行評審
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Sensorless Current Balancing Control for Transormerless Interleaved Boost 3X Converter
Chen, H. C., Lin, Y. T., Chen, C. H. & Li, C. Y., 2025, (待刊) 於: IEEE Transactions on Industry Applications.研究成果: 期刊稿件 › 文章 › 同行評審
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Interactive Analog IC Layout Tool with Real-time Parasitic-aware Automatic Routing Assistance
Chen, Y. T., Nien, C. F., Hsia, C. & Li, C. Y., 2024, APCCAS and PrimeAsia 2024 - 2024 IEEE 20th Asia Pacific Conference on Circuits and Systems and IEEE Asia Pacific Conference on Postgraduate Research in Microelectronics Electronics, Proceeding. Institute of Electrical and Electronics Engineers Inc., p. 149-153 5 p. (APCCAS and PrimeAsia 2024 - 2024 IEEE 20th Asia Pacific Conference on Circuits and Systems and IEEE Asia Pacific Conference on Postgraduate Research in Microelectronics Electronics, Proceeding).研究成果: 圖書/報告稿件的類型 › 會議稿件 › 同行評審
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Low-latency and power-efficient row-based binary-weighted compensator for fixed-width Booth multiplier
Li, C. Y., Hu, H. C., Chen, Y. H. & Lin, S. Y., 2024, (待刊) 於: International Journal of Circuit Theory and Applications.研究成果: 期刊稿件 › 文章 › 同行評審
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Sensorless Current Balancing Control for Interleaved Boost 3X Converter
Chen, H. C., Lin, Y. T., Chen, C. H. & Li, C. Y., 2024, 2024 IEEE Applied Power Electronics Conference and Exposition, APEC 2024. Institute of Electrical and Electronics Engineers Inc., p. 1893-1899 7 p. (Conference Proceedings - IEEE Applied Power Electronics Conference and Exposition - APEC).研究成果: 圖書/報告稿件的類型 › 會議稿件 › 同行評審
1 引文 斯高帕斯（Scopus）