Hwang-Cherng Chow

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2012
A pulse-width control loop for power electronics applications
Chow, H. C. & Huang, J. H., 2012, 於: Energy Procedia. 16, PART B, p. 1247-1252 6 p.
研究成果: 期刊稿件 › 會議文章 › 同行評審

開啟存取
High resolution successive approximation ADC for low power biomedical applications
Chow, H. C. & Lin, W. T., 2012, 於: Procedia Engineering. 50, p. 275-283 9 p.
研究成果: 期刊稿件 › 會議文章 › 同行評審

開啟存取
2 引文斯高帕斯（Scopus）
2005
A 1.8v, 0.3mw, 10-bit sa-adc with new self-timed timing control for biomedical applications
Chow, H. C., Chen, B. W., Chen, H. C. & Feng, W. S., 2005, 於: Proceedings - IEEE International Symposium on Circuits and Systems. p. 736-739 4 p., 1464693.
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13 引文斯高帕斯（Scopus）
2004
A reliable and high voltage compatible CMOS I/O buffer
Chow, H. C. & Chen, Y. G., 2004, 於: Midwest Symposium on Circuits and Systems. 3, p. III451-III454
研究成果: 期刊稿件 › 會議文章 › 同行評審
1 引文斯高帕斯（Scopus）
High performance sense amplifier circuit for low power SRAM applications
Chow, H. C. & Chang, S. H., 2004, 於: Proceedings - IEEE International Symposium on Circuits and Systems. 2, p. II741-II744
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24 引文斯高帕斯（Scopus）
New voltage level shifting circuits for low power CMOS interface applications
Chow, H. C. & Hsu, C. S., 2004, 於: Midwest Symposium on Circuits and Systems. 1, p. I533-I536
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4 引文斯高帕斯（Scopus）
2003
A 3.3V 1GHz low-latency pipelined booth multiplier with new Manchester carry-bypass adder
Cho, H. C. & Wey, I. C., 2003, 於: Proceedings - IEEE International Symposium on Circuits and Systems. 5, p. V121-V124
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7 引文斯高帕斯（Scopus）
2002
A 3.3V 1GHz high speed pipelined booth multiplier
Chow, H. C. & Wey, I. C., 2002, 於: Proceedings - IEEE International Symposium on Circuits and Systems. 1, p. I/457-I/460
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12 引文斯高帕斯（Scopus）
New pixel-shared design and split-path readout of CMOS image sensor circuits
Chow, H. C. & Ho, Y. K., 2002, 於: Proceedings - IEEE International Symposium on Circuits and Systems. 4, p. IV/49-IV/52
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